GOWIN FP Comp IP 및 참조 디자인 사용자 가이드

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부인 성명

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개정 내역

날짜	버전	설명
05/09/2024	1.0년대	최초 버전이 게시되었습니다.

이 가이드에 대해

목적

Gowin FP Comp IP 사용자 가이드의 목적은 기능, 포트, 타이밍, GUI 및 참조 디자인 등에 대한 설명을 제공하여 Gowin FP Comp IP의 기능과 사용법을 배울 수 있도록 돕는 것입니다. 본 매뉴얼은 Gowin Software V1.9.9 Beta-3을 기반으로 작성되었습니다. 소프트웨어는 예고 없이 변경될 수 있으므로 일부 정보는 관련성이 없을 수 있으며 사용 중인 소프트웨어에 따라 조정되어야 할 수도 있습니다.

용어 및 약어

본 매뉴얼에 사용된 용어 및 약어는 표 1-1과 같습니다.

표 1-1 용어 및 약어

용어 및 약어	의미
알루	산술 논리 유닛
정보	조회 테이블
IP	지적 재산권

지원 및 피드백

Gowin Semiconductor는 고객에게 포괄적인 기술 지원을 제공합니다. 질문, 의견 또는 제안 사항이 있는 경우 아래 제공된 정보를 사용하여 언제든지 직접 문의해 주시기 바랍니다.

Web대지: www.gowinsemi.com

이메일: support@gowinsemi.com

위에view

Gowin FP Comp IP는 더 적은 논리 자원으로 정수 덧셈과 나눗셈 연산을 실현하도록 설계되었습니다. Gowin FP Comp IP는 두 개의 단정밀도 부동 소수점 숫자를 비교할 수 있습니다. 이 IP는 A=B, A!=B, A>B, A>=B, A와 같은 선택적 출력 포트를 지원합니다.

표 2-1 Gowin FP Comp IP 초과view

고윈 FP Comp IP
논리 리소스	표 2-2을 참조하십시오.
배달된 문서
설계 Files	베릴로그
레퍼런스 디자인	베릴로그
테스트벤치	베릴로그
테스트 및 설계 흐름
합성 소프트웨어	고윈합성
응용 소프트웨어	Gowin 소프트웨어(V1.9.9.Beta-3 이상)

메모!

지원되는 장치에 대해 다음을 클릭할 수 있습니다. 여기 정보를 얻으려면.

특징

A=B, A!=B, A>B, A>=B, A와 같은 선택적 출력 포트 지원

최대 주파수

최대. Gowin FP Comp IP의 주파수는 주로 선택한 장치의 속도 등급에 따라 결정됩니다.

숨어 있음

Gowin FP Comp IP의 대기 시간은 구성 매개변수에 의해 결정됩니다.

자원 활용

Gowin FP Comp IP는 Verilog로 구현할 수 있습니다. 성능과 리소스 활용도는 설계가 다양한 장치에 적용되거나 밀도, 속도 또는 등급이 다를 때 달라질 수 있습니다. Gowin GW2A 55 시리즈 FPGA를 예로 들면, 리소스 활용도는 표 2-2와 같습니다. 다른 장치의 리소스 활용에 대해서는 이후 릴리스 정보를 참조하십시오.

표 2-2 자원 활용도

장치	속도 등급	자원 이름	자원 활용
GW2A-55	C8/I7	레지스터	5
		LUTs	110
		ALUs	38
		I/O 버퍼	13

기능 설명

Gowin FP Comp IP는 두 개의 단정밀도 부동 소수점 숫자의 비교를 구현할 수 있습니다. 사용자는 이 모듈을 생성할 때 요구 사항에 따라 매개변수를 구성할 수 있습니다.

포트 목록

Gowin FP Comp IP IO 포트의 세부 사항은 표 4-1에 나와 있으며 포트 다이어그램은 그림 4-1과 같습니다.

그림 4-1 Gowin FP Comp IP IO 포트 다이어그램

표 4-1 Gowin FP Comp IP IO 포트 목록

신호	입출력	설명
클락	입력	클럭 신호
rstn	입력	리셋 신호, 액티브 로우
ce	입력	클록 활성화 신호, 액티브 하이(옵션)
data_a	입력	입력하세요
데이터_b	입력	입력 b
에이비	산출	a=b (선택사항)
또는	산출	a!=b (선택 사항)

신호	입출력	설명
아그비	산출	a> b (선택 사항)
아게브	산출	a> = b (선택 사항)
장백의	산출	a< b (선택 사항)
알렙	산출	a< = b (선택 사항)
순서를 바꾸다	산출	NaN(선택사항)
결과	산출	출력 결과

타이밍 설명

이 섹션에서는 Gowin FP Comp IP의 타이밍에 대해 설명합니다. Gowin FP Comp IP의 타이밍은 그림 5-1과 같습니다.

그림 5-1 Gowin FP Comp IP 신호 타이밍

위 그림과 같이 단정밀도 부동소수점 데이터 2개를 입력한 후 1클럭 주기 지연 후 비교 결과가 출력됩니다.

GUI 구성

IP 생성

FP Comp를 호출하고 구성하려면 "도구 > IP 코어 생성기 > DSP 및 수학"을 클릭하세요. 그림 6-1과 같이 도구 모음 아이콘을 사용하여 IP를 열 수도 있습니다.

그림 6-1 아이콘을 통한 GUI 열기

구성 인터페이스

Gowin FP Comp IP 구성 인터페이스는 그림 6-2에 나와 있습니다.

그림 6-2 Gowin FP IP 구성 인터페이스

이 설명서에서는 GW2A-55 칩과 GW2A-LV55PG484C8/I7 부품 번호를 예로 들어 설명합니다.amp르.

“Create In” 텍스트 상자에서 생성된 IP 코어 폴더의 경로를 구성할 수 있습니다.

생성된 IP를 구성할 수 있습니다. file "에 이름File 이름” 텍스트 상자.
“모듈 이름” 텍스트 상자에서 생성된 IP 모듈 이름을 구성할 수 있습니다.

레퍼런스 디자인

Gowin FP Comp IP를 참조하세요. 레퍼런스 디자인 자세한 내용은 고윈세미에서 web대지.

File 배달

배달 file Gowin FP Comp IP에는 문서 및 참조 디자인이 포함되어 있습니다.

선적 서류 비치

폴더에는 주로 PDF 버전의 사용자 가이드가 포함되어 있습니다.

표 8-1 문서 목록

이름	설명
IPUG1049, Gowin FP Comp IP 사용자 가이드	Gowin FP Comp IP 사용자 가이드, 즉 이 가이드

레퍼런스 디자인

Gowin FP Comp IP RefDesign 폴더에는 넷리스트가 포함되어 있습니다. file, 사용자 참조 디자인, 제약 file, 최상위 file, 그리고 프로젝트 file, 등.

표 8-2 Gowin FP Comp IP RefDesign 폴더 콘텐츠 목록

이름	설명
top.v	레퍼런스 디자인의 최상위 모듈
FP_Comp.cst	프로젝트 물리적 제약 file
FP_Comp.sdc	프로젝트 타이밍 제약 file
FP_Comp.rao	온라인 로직 분석기 file
fp_comp.v	FP Comp IP 최상위 수준 생성 file, 암호화됨

문서 / 리소스

GOWIN FP Comp IP 및 참조 설계 [PDF 파일] 사용자 가이드
IPUG1049-1.0E, FP Comp IP 및 참조 디자인, Comp IP 및 참조 디자인, IP 및 참조 디자인, 참조 디자인, 디자인

참고문헌

사용자 설명서